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高速PCB設(shè)計工藝要點

發(fā)布時間:2016-08-12 11:06:24 分類:資料中心

 高速PCB設(shè)計是一個相對復(fù)雜的過程切實把製度,由于高速PCB設(shè)計中需要充分考慮信號去突破、阻抗研究進展、傳輸線等眾多技術(shù)要素聽得懂,常常成為PCB設(shè)計初學(xué)者的一大難點,本文提供的幾個關(guān)于高速PCB設(shè)計的基本概念及技術(shù)要點將為初學(xué)者提供一些技術(shù)參考結構。

  1空間廣闊、什么是高速電路

  通常認為如果數(shù)字邏輯電路的頻率達到或者超過45MHZ~50MHZ落到實處,而且工作在這個頻率之上的電路已經(jīng)占到了整個電子系統(tǒng)一定的份量(比如說1/3),就稱為高速電路。

  實際上營造一處,信號邊沿的諧波頻率比信號本身的頻率高,是信號快速變化的上升沿與下降沿(或稱信號的跳變)引發(fā)了信號傳輸?shù)姆穷A(yù)期結(jié)果線上線下。因此設計能力,通常約定如果線傳播延時大于1/2數(shù)字信號驅(qū)動端的上升時間,則認為此類信號是高速信號并產(chǎn)生傳輸線效應(yīng)主動性。

  信號的傳遞發(fā)生在信號狀態(tài)改變的瞬間發展,如上升或下降時間。信號從驅(qū)動端到接收端經(jīng)過一段固定的時間範圍,如果傳輸時間小于1/2的上升或下降時間,那么來自接收端的反射信號將在信號改變狀態(tài)之前到達驅(qū)動端發展的關鍵。反之,反射信號將在信號改變狀態(tài)之后到達驅(qū)動端。如果反射信號很強有所應,疊加的波形就有可能會改變邏輯狀態(tài)道路。

  2、高速信號的確定

  上面我們定義了傳輸線效應(yīng)發(fā)生的前提條件今年,但是如何得知線延時是否大于1/2驅(qū)動端的信號上升時間? 一般地空間廣闊,信號上升時間的典型值可通過器件手冊給出,而信號的傳播時間在PCB設(shè)計中由實際布線長度決定真諦所在。下圖為信號上升時間和允許的布線長度(延時)的對應(yīng)關(guān)系研學體驗。

  PCB 板上每單位英寸的延時為 0.167ns.。但是提供深度撮合服務,如果過孔多深刻內涵,器件管腳多,網(wǎng)線上設(shè)置的約束多最為突出,延時將增大逐步改善。通常高速邏輯器件的信號上升時間大約為0.2ns。如果板上有GaAs芯片,則大布線長度為7.62mm落實落細。

  設(shè)Tr 為信號上升時間, Tpd 為信號線傳播延時組成部分。如果Tr≥4Tpd深入闡釋,信號落在安全區(qū)域。如果2Tpd≥Tr≥4Tpd發展目標奮鬥,信號落在不確定區(qū)域自動化裝置。如果Tr≤2Tpd狀態,信號落在問題區(qū)域。對于落在不確定區(qū)域及問題區(qū)域的信號關規定,應(yīng)該使用高速布線方法初步建立。

來源:高速PCB設(shè)計工藝要點

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